1.1.1.遵照“先大后小，先难后易”的布置原则，即重要的单元电路、核心元器件应当优先布局． 1.1.2.布局中应参考原理框图，根据单板的主信号流向规律安排主要元器件． 1.2.布局应满足以下要求:
1.2.1.总的连线尽可能短，
1.2.2.关键信号线最短;
1.2.3.高电压、大电流信号与小电流，低电压的弱信号完全分开;
1.2.4.模拟信号与数字信号分开；
1.2.5.高频信号与低频信号分开；
1.2.6.高频元器件的间隔要充分．
1.2.7.相同结构电路部分，尽可能采用“对称式”标准布局；
1.2.8.按照均匀分布、重心平衡、版面美观的标准优化布局；
1.2.9.器件布局栅格的设置，一般IC器件布局时，栅格应为50--100 mil,小型表面安装器件，如表面贴装元件布局时，栅格设置应不少于25mil。 1.2.10.根据结构图设置板框尺寸，按结构要素布置安装孔、接插件等需要定位的器件，并给这些器件赋予不可移动属性。 按工艺设计规范的要求进行尺寸标注。
1.2.11.根据结构图和生产加工时所须的夹持边设置印制板的禁止布线区、禁止布局区域。根据某些元件的特殊要求，设置禁止布线区。 1.2.12.综合考虑PCB性能和加工的效率选择加工流程。
1.2.13.加工工艺的优选顺序为：元件面单面插装——元件双插装。
1.2.14.同类型插装元器件在X或Y方向上应朝一个方向放置。同一种类型的有极性分立元件也要力争在X或Y方向上保持一致，便于生产和检验。
1.2.15.发热元件要一般应均匀分布，以利于单板和整机的散热，除温度检测元件以外的温度敏感器件应远离发热量大的元器件。
1.2.16.元器件的排列要便于调试和维修，亦即小元件周围不能放置大元件、需调试的元、器件周围要有足够的空间。
1.2.17.需用波峰焊工艺生产的单板，其紧固件安装孔和定位孔都应为非金属化孔。当安装孔需要接地时, 应采用分布接地小孔的方式与地平面连接。
1.2.18.焊接面的贴装元件采用波峰焊接生产工艺时，阻、容件轴向要与波峰焊传送方向垂直， 阻排及SOP（PIN间距大于等于1.27mm）元器件轴向与传送方向平行；PIN间距小于1.27mm（50mil)的IC、SOJ、PLCC、QFP等有源元件避免用波峰焊焊接。
1.2.19.BGA与相邻元件的距离>5mm。其它贴片元件相互间的距离>0.7mm；贴装元件焊盘的外侧与相邻插装元件的外侧距离大于2mm；有压接件的PCB，压接的接插件周围5mm内不能有插装元、器件，在焊接面其周围5mm内也不能有贴装元、器件。
1.2.20.IC去偶电容的布局要尽量靠近IC的电源管脚，并使之与电源和地之间形成的回路最
短。
1.2.21.元件布局时,应适当考虑使用同一种电源的器件尽量放在一起, 以便于将来的电源分隔。
1.2.22.用于阻抗匹配目的阻容器件的布局，要根据其属性合理布置。
1.2.22.1.串联匹配电阻的布局要靠近该信号的驱动端，距离一般不超过500mil。
1.2.22.2.匹配电阻、电容的布局一定要分清信号的源端与终端，对于多负载的终端匹配一定要在信号的最远端匹配。
1.2.23.布局完成后打印出装配图供原理图设计者检查器件封装的正确性，并且确认单板、背板和接插件的信号对应关系，经确认无误后方可开始布线。
1.3.设置布线约束条件
1.3.1.报告设计参数布局基本确定后，应用PCB设计工具的统计功能，报告网络数量，网络密度，平均管脚密度等基本参数，以便确定所需要的信号布线层数。
1.3.2.信号层数的确定可参考以下经验数据
①Pin密度
②信号层数
③板层数
注：PIN密度的定义为： 板面积（平方英寸）/（板上管脚总数/14）
1.3.3.布线层数的具体确定还要考虑单板的可靠性要求，信号的工作速度，制造成本和交货期等因素。
1.4.布线层设置
1.4.1.在高速数字电路设计中，电源与地层应尽量靠在一起，中间不安排布线。所有布线层都尽量靠近一平面层，优选地平面为走线隔离层。
1.4.2.为了减少层间信号的电磁干扰，相邻布线层的信号线走向应取垂直方向。
1.4.3.可以根据需要设计1--2个阻抗控制层，如果需要更多的阻抗控制层需要与PCB产家协商。阻抗控制层要按要求标注清楚。将单板上有阻抗控制要求的网络布线分布在阻抗控制层上。
1.5.阿嫂传奇线宽和线间距的设置
1.5.1.线宽和线间距的设置要考虑的因素
1.5.1.1.单板的密度。板的密度越高，倾向于使用更细的线宽和更窄的间隙。
1.5.2.信号的电流强度：
当信号的平均电流较大时，应考虑布线宽度所能承载的的电流，线宽可参考以下数据：
1.5.2.1.PCB设计时铜箔厚度,走线宽度和电流的关系
1.5.2.2.不同厚度，不同宽度的铜箔的载流量见下表:
1.5.2.3.铜皮厚度35um 铜皮厚度50um 铜皮厚度70um
1.5.2.4.铜皮Δt=10℃ 铜皮Δt=10℃ 铜皮Δt=10℃
注：
●用铜皮作导线通过大电流时，铜箔宽度的载流量应参考表中的数值降额50%去选择考虑。
●在PCB设计加工中，常用OZ（盎司）作为铜皮厚度的单位，1 OZ铜厚的定义为1 平方英尺面积内铜箔的重量为一盎，对应的物理厚度为35um；2OZ铜厚为70um。
1.6.电路工作电压
1.6.1.线间距的设置应考虑其介电强度。
出版管理条例
1.6.2.输入150V-300V电源最小空气间隙及爬电距离
1.6.3.输入300V-600V电源最小空气间隙及爬电距离
1.7.PCB加工技术限制
1.7.1.国内 国际先进水平
1.7.2.推荐使用最小线宽/间距 6mil/6mil 4mil/4mil
1.7.3.极限最小线宽/间距 4mil/6mil 2mil/2mil
1.8.孔的设置
1.8.1.过线孔：制成板的最小孔径定义取决于板厚度，板厚孔径比应小于 5--8。
1.8.1.1.孔径优选系列如下：
●孔径： 24mil 20mil 16mil 12mil 8mil
●焊盘直径： 40mil 35mil 28mil 25mil 20mil
●内层热焊盘尺寸： 50mil 45mil 40mil 35mil 30mil
1.8.1.2.板厚度与最小孔径的关系：
●板厚： 3.0mm 2.5mm 2.0mm 1.6mm 1.0mm
●最小孔径： 24mil 20mil 16mil 12mil 8mil
●品板表层不可见的导通孔，这两类过孔尺寸设置可参考过线孔。
●来不必要的问题，必要时要与PCB供应商协商。
1.8.2.测试孔
1.8.2.1.测试孔是指用于ICT测试目的的过孔，可以兼做导通孔，原则上孔径不限，焊盘直径应不小于25mil，测试孔之间中心距不小于50mil。
1.8.2.2.不推荐用元件焊接孔作为测试孔。
1.9.特殊布线区间的设定
特殊布线区间是指单板上某些特殊区域需要用到不同于一般设置的布线参数，如某些高密度器件需要用到较细的线宽、较小的间距和较小的过孔等，或某些网络的布线参数的调整等，需要在布线前加以确认和设置。
1.9.1.定义和分割平面层
1.9.2.平面层一般用于电路的电源和地层（参考层），由于电路中可能用到不同的电源和地层，需要对电源层和地层进行分隔，其分隔宽度要考虑不同电源之间的电位差，电位差大于12V时，分隔宽度为50mil，反之，可选20--25mil 。
1.9.3.平面分隔要考虑高速信号回流路径的完整性。
1.9.4.当由于高速信号的回流路径遭到破坏时，应当在其他布线层给予补尝。例如可用接地的铜箔将该信号网络包围，以提供信号的地回路。
1.10.细胞生长肽布线
1.10.1.布线优先次序
1.10.1.1.关键信号线布线优先：
●电源线；
●摸拟小信号；
●高速信号；
●时钟信号；
●同步信号；
氟苯尼考琥珀酸钠1.10.1.2.密度优先原则：
●从单板上连接关系最复杂的器件着手布线；
●从单板上连线最密集的区域开始布线；
1.10.2.马兰士cd6003关键信号优先保证其最小的回路面积，必要时应采取手工优先布线、屏蔽和加大安全间距等方法。：
●时钟信号；
●高频信号；
●敏感信号等，
1.10.3.电源层和地层之间的EMC环境较差，应避免布置对干扰敏感的信号。
1.10.4.有阻抗控制要求的网络应布置在阻抗控制层上。
1.10.5.不推荐使用自动布线；
1.11.进行PCB布线时应该遵循的规则
1.11.1.地线回路规则：
环路最小规则，即信号线与其回路构成的环面积要尽可能小，环面积越小，对外的辐射越少，接收外界的干扰也越小。针对这一规则，在地平面分割时，要考虑到地平面与重要信号走线的分布，防止由于地平面开槽等带来的问题；在双层板设计中，在为电源留下足够空间的情况下，应该将留下的部分用参考地填充，且增加一些必要的孔，将双面地信号有效连接起来，对一些关键信号尽量采用地线隔离，对一些频率较高的设计，需特别考虑其地平面信号回路问题，建议采用多层板为宜。
1.11.2.窜扰控制
串扰（CrossTalk)是指PCB上不同网络之间因较长的平行布线引起的相互干扰，主要是由于平行线间的分布电容和分布电感的作用。
1.11.2.1.克服串扰的主要措施是：
●加大平行布线的间距，遵循3W规则。
●在平行线间插入接地的隔离线。
●减小布线层与地平面的距离。
1.11.3.屏蔽保护对应地线回路规则；
实际上也是为了尽量减小信号的回路面积，多见于一些比较重要的信号，如时钟信号，同步信号；对一些特别重要，频率特别高的信号，应该考虑采用铜轴电缆屏蔽结构设计，即将所布的线上下左右用地线隔离，而且还要考虑好如何有效的让屏蔽地与实际地平面有效结合。
1.11.4.走线的方向控制规则：
即相邻层的走线方向成正交结构。避免将不同的信号线在相邻层走成同一方向，以减少不必要的层间窜扰；当由于板结构限制（如某些背板）难以避免出现该情况，特别是信号速
率较高时，应考虑用地平面隔离各布线层，用地信号线隔离各信号线。
1.11.5.走线的开环检查规则：
一般不允许出现一端浮空的布线（Dangling Line),
主要是为了避免产生"天线效应"，减少不必要的干扰辐射和接受，否则可能带来不可预知的结果。
1.11.6.阻抗匹配检查规则：
同一网络的布线宽度应保持一致，线宽的变化会造成线路特性阻抗的不均匀，当传输的速度较高时会产生反射，在设计中应该尽量避免这种情况。在某些条件下，如接插件引出线，BGA封装的引出线类似的结构时，可能无法避免线宽的变化，应该尽量减少中间不一致部分的有效长度。
1.11.7.走线终结网络规则：
在高速数字电路中，当PCB布线的延迟时间大于信号上升时间（或下降时间）的1/4时，该
布线即可以看成传输线，为了保证信号的输入和输出阻抗与传输线的阻抗正确匹配，可以采用多种形式的匹配方法，所选择的匹配方法与网络的连接方式和布线的拓朴结构有关。
1.11.7.1.对于点对点（一个输出对应一个输入）连接，可以选择始端串联匹配或终端并联匹配。前者结构简单，成本低，但延迟较大。后者匹配效果好，但结构复杂，成本较高。
1.11.7.2.对于点对多点（一个输出对应多个输出）连接，当网络的拓朴结构为菊花链时，应选择终端并联匹配。当网络为星型结构时，可以参考点对点结构。
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1.11.7.3.星形和菊花链为两种基本的拓扑结构, 其他结构可看成基本结构的变形, 可采取一些灵活措施进行匹配。
在实际操作中要兼顾成本、功耗和性能等因素，一般不追求完全匹配，只要将失配引起的反射等干扰限制在可接受的范围即可。
1.11.8.走线闭环检查规则：
防止信号线在不同层间形成自环。在多层板设计中容易发生此类问题，自环将引起辐射干扰。
1.11.9.走线的分枝长度控制规则：
尽量控制分枝的长度，一般的要求是Tdelay<=Trise/20。
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