《数字电子技术》判断题题库
判断题（正确打√，错误的打×）
1. 方波的占空比为0.5。（ √ ）
2 数字电路中用“1”和“0”分别表示两种状态，二者无大小之分。（ √ ）
3．格雷码具有任何相邻码只有一位码元不同的特性。（ √ ）
4．八进制数（18）8比十进制数（18）10小。（ √ ）
5．当传送十进制数5时，在8421奇校验码的校验位上值应为1。（ √ ）
6．在时间和幅度上都断续变化的信号是数字信号，语音信号不是数字信号。（ √ ） 7．占空比的公式为：q = t w / T，则周期T越大占空比q越小。（ × ）
8．十进制数（9）10比十六进制数（9）16小。（ √ ）
9．当8421奇校验码在传送十进制数（8）10时，在校验位上出现了1时，表明在传送过程中出现了错误。（ √ ）
11．异或函数与同或函数在逻辑上互为反函数。（ √施密特触发器芯片 ）。 12．若两个函数具有相同的真值表，则两个逻辑函数必然相等。（ √ ）。
13．因为逻辑表达式A+B+AB=A+B成立，所以AB=0成立。（ × ）
14．若两个函数具有不同的真值表，则两个逻辑函数必然不相等。（ √ ）
15．若两个函数具有不同的逻辑函数式，则两个逻辑函数必然不相等。（ × ）
16．逻辑函数两次求反则还原，逻辑函数的对偶式再作对偶变换也还原为它本身。（ √ ）
17．逻辑函数Y=A+B+C+B已是最简与或表达式。（ × ）
18．因为逻辑表达式A+B +AB=A+B+AB成立，所以A+B= A+B成立。（ × ）
19．对逻辑函数Y=A+B+C+B利用代入规则，令A=BC代入，得Y= BC+B+C+B=C+B成立。（ × ）
20．TTL与非门的多余输入端可以接固定高电平。（ √ ）
21．当TTL与非门的输入端悬空时相当于输入为逻辑1。（ √ ）
22．普通的逻辑门电路的输出端不可以并联在一起，否则可能会损坏器件。（ √ ） 23．两输入端四与非门器件74LS00与7400的逻辑功能完全相同。（ √ ）
24．CMOS或非门与TTL或非门的逻辑功能完全相同。（ √ ）
25．三态门的三种状态分别为：高电平、低电平、不高不低的电压。（ × ）
26．TTL集电极开路门输出为１时由外接电源和电阻提供输出电流。（ √ ）
27．一般TTL门电路的输出端可以直接相连，实现线与。（ × ）
28．TTL OC门（集电极开路门）的输出端可以直接相连，实现线与。（ √ ）
29．D触发器的特性方程为Qn+1=D，与Qn无关，所以它没有记忆功能。（ × ）
30．RS触发器的约束条件RS=0表示不允许出现R=S=1的输入。（ √ ）
31．同步触发器存在空翻现象，而边沿触发器和主从触发器克服了空翻。（ √ ）
32．主从JK触发器、边沿JK触发器和同步JK触发器的逻辑功能完全相同。（ √ ）
33．若要实现一个可暂停的一位二进制计数器，控制信号A=0计数，A=1保持，可选用T触发器，且令T=A。（ × ） 34．由两个TTL或非门构成的基本RS触发器，当R=S=0时，触发器的状态为不定。(√)
35．对边沿JK触发器，在CP为高电平期间，当J=K=1时，状态会翻转一次。（ × ）
36．施密特触发器可用于将三角波变换成正弦波。（ × ）
37．施密特触发器有两个稳态。（ √ ）
38．多谐振荡器的输出信号的周期与阻容元件的参数成正比。（ √ ）
39．石英晶体多谐振荡器的振荡频率与电路中的R、C成正比。（ × ）
40．单稳态触发器的暂稳态时间与输入触发脉冲宽度成正比。（ × ）
41．单稳态触发器的暂稳态维持时间用tW表示，与电路中RC成正比。（ √ ）
42．采用不可重触发单稳态触发器时，若在触发器进入暂稳态期间再次受到触发，输出脉宽可在此前暂稳态时间的基础上再展宽tW。（ ×）
43．施密特触发器的正向阈值电压一定大于负向阈值电压。（ √ ）
44．优先编码器的编码信号是相互排斥的，不允许多个编码信号同时有效。（ × ）
45．编码与译码是互逆的过程。（ √ ）
46．二进制译码器相当于是一个最小项发生器，便于实现组合逻辑电路。（ √ ）
47．液晶显示器的优点是功耗极小、工作电压低。（ √ ）
48．半导体数码显示器的工作电流大，约10mA左右，因此，需要考虑电流驱动能力问题。
（ √ ）
49．共阴接法发光二极管数码显示器需选用有效输出为高电平的七段显示译码器来驱动。（ √ ）
50．数据选择器和数据分配器的功能正好相反，互为逆过程。（ √ ）
51．用数据选择器可实现时序逻辑电路。（ √ ）
52．组合逻辑电路中产生竞争冒险的主要原因是输入信号受到尖峰干扰。（ × ）
53．时序逻辑电路由组合电路和存储器（触发器）两部分组成。（ √ ）
54．组合电路不含有记忆功能的器件。（ √ ）
55．时序电路不含有记忆功能的器件。（ × ）
56．同步时序电路具有统一的时钟CP控制。（ √ ）
57．异步时序电路的各级触发器类型不同。（ × ）
58．环形计数器在每个时钟脉冲CP作用时，仅有一位触发器发生状态更新。（ × ）
59．环形计数器如果不作自启动修改，则总有孤立状态存在。（ √ ）
60．计数器的模是指构成计数器的触发器的个数。（ × ）
61．计数器的模是指对输入的计数脉冲的个数。（ √ ）
62．D触发器的特征方程Qn+1=D，而与Qn无关，所以，D触发器不是时序电路。（ × ）
62．在同步时序电路的设计中，若最简状态表中的状态数为2N，而又是用N级触发器来实现其电路，则不需检查电路的自启动性。（ √ ）
63．把一个5进制计数器与一个10进制计数器串联可得到15进制计数器。（× ）
64．同步二进制计数器的电路比异步二进制计数器复杂，所以实际应用中较少使用同步二进制计数器。（ × ）
65．利用反馈清零法获得N进制计数器时，若为异步清零方式，则状态SN只是短暂的过渡
状态，不能稳定而是立刻变为0状态。（ √ ）
66．权电阻网络D/A转换器的电路简单且便于集成工艺制造，因此被广泛使用。（ × ）
67．D/A转换器的最大输出电压的绝对值可达到基准电压VREF。（ × ）
68．D/A转换器的位数越多，能够分辨的最小输出电压变化量就越小。（ √ ）
69．D/A转换器的位数越多，转换精度越高。（ √ ）
70．A/D转换器的二进制数的位数越多，量化单位△越小。（ √ ）
71．A/D转换过程中，必然会出现量化误差。（ √ ）
72．A/D转换器的二进制数的位数越多，量化级分得越多，量化误差就可以减小到0。（ × ）
73．一个N位逐次逼近型A/D转换器完成一次转换要进行N次比较，需要N+2个时钟脉冲。（ √）
74．双积分型A/D转换器的转换精度高、抗干扰能力强，因此常用于数字式仪表中。（ √ ）
75．采样定理对采样频率的规定，是为了能不失真地恢复原模拟信号，而又不使电路过于复杂。（√ ）
76．实际中，常以字数和字节数的乘积表示存储容量。（ √ ）
77．RAM由若干位存储单元组成，每个存储单元可存放一位二进制信息。（ √ ）
78．动态随机存取存储器需要不断地刷新，以防止电容上存储的信息丢失。（√ ）
79．用2片容量为16K×8的RAM构成容量为32K×8的RAM是位扩展。（ × ）
80．所有的半导体存储器在运行时都具有读和写的功能。（ × ）
81．ROM和RAM中存入的信息在电源断掉后都不会丢失。（ × ）
82．RAM中的信息，当电源断掉后又接通，则原存的信息不会改变。（× ）
83．存储器字数的扩展可以利用外加译码器控制数个芯片的片选输入端来实现。（ √ ）
84．PROM的或阵列（存储矩阵）是可编程阵列。（ √ ）
85．ROM的每个与项（地址译码器的输出）都一定是最小项。（ √ ）
86．PROM不仅可以读，也可以写（编程），则它的功能与RAM相同。（ × ）
87．PAL的每个与项都一定是最小项。（ × ）
88．PAL和GAL都是与阵列可编程、或阵列固定。（ √ ）
89．PAL可重复编程。（ × ）
90．PAL的输出电路是固定的，不可编程，所以它的型号很多。（ √ ）
91．GAL的型号虽然很少，但却能取代大多数PAL芯片。（ √ ）
92．ABEL语言是一种通用的硬件描述语言（HDL），用于PLD的开发。（ √ ）
93．GAL不需专用编程器就可以对它进行反复编程。（ × ）
94．在系统可编程逻辑器件ISP-PLD不需编程器就可以高速而反复地编程，则它与RAM随机存取存储器的功能相同。（ × ）
95．PLA是全场可编程（与、或阵列皆可编程）的可编程逻辑器件，功能强大，便于使用，因此被普遍使用。（ × ）
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