数字钟设计要求及方案(采用CMOS集成电路)

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微安表数字钟设计方案数字钟设计方案（要求采用设计方案（要求采用 CMOS 集成电路）一、包含模块 1. 标准秒脉冲发生电路：由 555 集成定时器与 RC 组成的多谐振荡器作为时间标准信号源，发出频率为 1KHz。再经过 3 级十分频（3 个十进制计数器）后得到 1Hz； 2. 24 分 60 秒计时电路； 3. 译码显示电路； 4. 校分电路：直接连线（或用开关）来进行快速校分。二、包含元器件 2KΩ 电阻 1 个 5.1KΩ 电阻 1 个 10KΩ 可调电阻 1 个 0.1µF 电容 1 个（即 104） 0.01µF 电容 1 个（即 103） 555 集成块 1 块 CD4510 集成块 7 块（十进制同步加/减计数器） CD4011 集成块 1 块（2 输入端 4 与非门） CD4511 集成块 4 块（7 段译码器/驱动器） 0511AS 共阴极数码管 4 块 510Ω 电阻 28 个

三、所需仪器设备 1. 直流稳压电源、示波器和数字万用表 2. 面包板、尖嘴钳或镊子、斜口钳或剪刀，导线若干四、 555 振荡器

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五、扩展功能（1）快速校时电路的设计：可以对时间进行快速预置，也就实现了对时间的校正。（2）定时控制电路的设计：数字钟在指定的时刻发出信号，或驱动音响电路“闹时” ，或对某装置的电源进行接通或断开“控制” 。不管是闹时还是控制，都要求时间准确，即信号的开始时刻与持续时间必须满足规定的要求。要求在 17 分时发出闹时信号，扬声器发出 1KHz 的声音，持续时间为 1 分钟。（3）仿广播电台正点报时电路的设计：每当数字钟计时快要到正点时发出声响，通常按照 4 低音 1 高音的顺序发出间断声响，以最后一声高音结束的时刻为正点时刻。设 4 声低音（约 500Hz）发生在 23 分的 51 秒、53 秒、55 秒及 57 秒，最后一声高音（约为 1KHz）发生在 23 分 59 秒，它们的持续时间

www.pkk123数据库探针均为 1 秒。

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